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Cadence Crake破解版存在哪些问题?
2016-04-25 15:38:16

问题描述:
Cadence Crake破解版存在哪些问题?
 
解答:
Cadence软件自16.0以后的版本,破解方法都是Crake的暴力破解方式,即采用修改程序本身,同时修改软件注册表信息的方式。这种暴力破解方式,对于Cadence工具而言是致命的,Cadence软件中包含了设计与仿真相关的很多程序,因为修改程序本身运行参数以及注册表信息,很多程序无法正常运行,甚至很多程序根本无法打开。这样的结果,轻则影响项目进度,重则影响数据的正确性,工程错误将无法避免。
 
截止目前,我们在与很多Cadence客户的交流中,客户之前使用Cadence破解版时遇到过以下这些随机的问题,当然这些随机产生的问题,我们也无法给出准确的原因:
 
1.  CIS中心库无法正常使用到原理图中,中心库元件调用至Capture原理图中,Value/Part Preference等信息会远离元件本身,与元件中心库不符,导致中心库无法正常使用;
 
2.  CIS中心库无法正常配置,与Windows系统的ODBC数据源无法正确链接;
 
3.  Capture绘制原理图的过程中,软件毫无征兆的当机崩溃,并自动退出,导致原理图设计必须重新绘制;
 
4.  Capture原理图设计中的自动布线功能无法正常使用,实现自动总线互联时,网络名无法正常自动输出;
 
5.  Cadence中模块复用功能无法正常使用,模块无法再CIS中心库中进行统一管理;
 
6.  Capture在进行层次电路设计时,经常软件崩溃,自动退出;
 
7.  Capture无法正常进行变量化报表输出,导致原理图输出多报表的过程非常复杂费时;
 
8.  原理图设计完成后,若要进行后期PSpice电路仿真,PSpice无法打开;
 
9.  若原理图PSpice仿真界面打开,其中类似参数扫描、蒙特卡洛分析等仿真功能无法正常使用;
 
10.原理图PSpice仿真时,模型被暴力破解破坏,导致仿真结果错误,如:直流分析中电容应为开路状态,破解版PSpice模型中电容直流下竟是短路状态;
 
11.原理图高级分析优化工PSpice A/A无法打开;
 
12.Allegro PCB进行布局布线时,软件突然毫无征兆的崩溃,并自动退出,重新打开软件后,只要点击Options/Find/Corlor对话框,软件就会自动退出,然而这个对话框在设计的过程中是不可或缺的;
 
13.Allegro PCB设计中的Room布局无法正常使用,使得布局时间大为增加,效率低下;
 
14.破解版Allegro无法正常使用Stroke快捷键操作,若使用,则软件自动退出;
 
15.Allegro规则管理器Constraint Manager中差分对、总线时序匹配、Same Net Spacing同网络间距等规则无法正常设置于调用,导致PCB设计完成后无法检查这些规则,目前项目AI-17-1_00_1224-1中就无法检查同网络两个铜皮之间Same Net Spacing间距,CM中哪些规则无法正常检查,具有不确定性,因此,设计完成后不能确保设计的可靠性;
 
16.Constraint Manager无法实现On-line DRC,即检查PCB上DRC,必须全PCB运行DRC Check;
 
17.Constraint Manager无法与Signal Xplorer实现互联,即SI仿真无法指导高速信号的约束规则设置;
 
18.Allegro中无法正常的绘制与编辑Dynamic Shape动态铜皮,有时即使可以绘制动态铜皮,也无法进行自动避让;
 
19.PCB数据损坏,过孔、通孔焊盘无法正常输出Gerber,且不能提取拓扑进行SI信号完整性仿真;
 
20.负片设计中,Flash热风焊盘/Anti Pad隔离盘在负片电源、地铜皮上无法正常建立,或者无法正确输出Gerber,往往导致Gerber中过孔、通孔焊盘内电层互联错误,并导致PCB生产为费板。
 
21.Allegro SI仿真算法被破坏,导致信号完整性仿真得到的波形与实际波形相差甚远,进而导致高速信号SI仿真毫无指导意义。

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