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Allegro Design Entry Capture CIS

概述

Capture CIS提供了完整的、可调整的技术,应用于印刷电路板(PCB)的设计创建、管理和重用。将原理图设计输入功能与广泛的仿真和电路板布局技术相结合,Cadence能够帮助你一开始就抓住设计意图。不管是用于设计新的模拟电路、为现有的PCB修改原理图图表,还是设计一个带有HDL模块的数字块图表,Design Entry CIS原理图输入技术让设计师可以输入、修改和检验PCB设计。它还加入了强大的元件信息系统(CIS),促进首选元件和已知有用数据的重用。这种易于使用的技术让设计师能够将他们的创造力用于设计捕捉,而不是工具操作。

 

 

优点

  • 提供高速直观的原理图编辑方式。

  • 通过层次式和模块复用设计提高复杂原理图的设计效率。

  • 具备强大功能的CIS,帮助加速设计进程,降低项目成本。

  • 提供与Allegro PCB Editor之间的交互布局。

  • 与AMS-Simulatuor集成,可直接基于原理图进行电路仿真分析。

  • 提供ERP和PLM的数据库的数据交互方法。

 

功能特征

原理图编辑

功能完整的原理图编辑器让用户可以从全面的功能库中放置和连接各器件。它将各器件进行独特地封包,保证设计完整性,并为Cadence支持的任意格式创建设计网表。用户可以在单次会话中浏览和编辑多个原理图设计,并且在原理图之间复制和粘贴设计数据,实现数据重用。该原理图编辑器还支持为PCB编辑流程加入设计编辑的关键约束。

项目管理器

项目管理器让用户可以在整个设计流程中收集和整理项目所需的所有资源。展开的树状结构使其易于整理和查找设计文件,包括由PSpice和Allegro AMS仿真器、OrCAD Capture CIS、Allegro Design Entry CIS和其他插件生成的文件。

层级设计和重用

不需要进行多重复制的支电路重用可提高原理图编辑效率。使用层级块,设计师只需要多次参考相同的支电路。层级端口的自动创建消除了可能出现的设计连接错误。端口和引脚可以为层级块和底层原理图动态更新。附加的导航功能可使用快捷键识别模块边界和访问性。

                           

原理图符号库与原理图局部编辑

库编辑器可直接从用户界面访问。用户可以在库中创建和编辑各个部分,或者直接从原理图页面编辑原理图符号库,而无需干扰工作流程。直观的图形化控制加快了原理图局部的创建与编辑。元件可以通过已有元件迅速修改创建,也可以从电子数据表中创建。元件库器件生成器将FPGA和PLD自动集成到系统原理图中。生成部分功能可为高引脚数的设备简化核心FPGA库器件的创建。这些器件可以被分拆为多个器件。

简易数据输入

设计师可以调用所有器件、网络、引脚和工程图明细表属性或者任何对象,并通过电子表格属性编辑器迅速进行更改。需要选择电路元件、群组地区、或者整个页面,然后编辑器件、网络或引脚属性。

元件信息系统

Allegro Design Entry CIS和OrCAD Capture CIS将元件信息系统(CIS)的功能特性与Cadence原理图输入技术相结合。该产品通过元件的有效管理减少设计数据从源头上错误,减少了搜索现有器件进行重用的时间、减少手动输入器件信息内容和维护元件数据的时间。用户可以根据它们的电气参数特性搜索器件,而CIS会自动取回相关器件。CIS非常适合单个设计团队或者需要跨越多个地点合作的多个团队。它让设计师能够在设计流程的初期就能调用正确的器件资料并且可以让完整的规格传递到电路板设计师和其他设计组员的手中,减少下行错误的可能性。它还提供了成本信息供调用,让设计师能够使用优选器件、低成本以及尚有存货的器件。内嵌的器件选择器可调用存储在企业物料库或ERP系统以及PDM数据库中的信息,并且它还可以让外部数据源与原理图设计数据库同步,综上,CIS能支持设计师快速获取具有完整物料信息的BOM文件。

      

拓展的CIS文件

CIS还提供了强大的报告生成功能。CIS不会将设计师局限于原理图的内在的内容,它还可以引用存在于首选器件数据库中的丰富信息,让报告生成功能进化到新的层次。设计师可以使用最新的、全面的以及完整的信息生成BOM,并通过Crystal报告引擎创建报告。

结构/数据库集成

接收插件进行可编程的逻辑设计和电路模拟仿真

允许在相同的环境中进行原理图设计和仿真

可与兼容微软ODBC的数据库配合

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